O projeto v0.5 da especificação da oitava geração do PCIe (Peripheral Component Interconnect Express) foi revelado antes do previsto,enquanto a conclusão oficial da norma completa permanece prevista para 2028.
As interconexões PCIe servem como canais críticos para conectar hardware periférico de alta velocidade a sistemas host.0 componentes tais como SSDs estão disponíveis comercialmenteA especificação finalizada do PCIe 7.0 foi lançada e a iteração do PCIe 8.0 está ativamente em andamento.
Total duplex por faixa de circulação
Impulsionados por cargas de trabalho de TI cada vez mais complexas e pela demanda dos utilizadores por um processamento de dados mais rápido, várias arquiteturas de computadores, incluindo x86, GPU,Arm e RISC-V estão a melhorar continuamente o desempenho da computaçãoA atualização do desempenho requer chips de computação para realizar entrada e saída de dados mais rápidos.e as ligações de interconexão que ligam estes periféricos também devem aumentar as velocidades de transmissão para acompanhar.
Tradicionalmente, o PCIe atua como o meio de conexão entre CPUs e GPUs.incentivando os fabricantes a adotar tecnologias de interconexão dedicadas, como o NVLink da NvidiaComo o padrão de interconexão principal para CPUs de arquitetura x86, o PCIe deve continuar a ser iterado para corresponder à melhoria de desempenho de gerações sucessivas de CPUs.
Para acomodar o fluxo de dados crescente dentro dos sistemas de computação, cada nova geração de PCIe duplica a velocidade de transferência de sua antecessora.
Uma ligação PCIe completa consiste em várias faixas paralelas, com a largura de banda de cada faixa atualizada para cada geração.duas vezes a taxa de 128 GT/s do PCIe 7.0Um gráfico dedicado demonstra intuitivamente o salto de velocidade significativo trazido pelas actualizações geracionais.
Servindo como a primeira edição formal do padrão, o projeto v0.5 integra feedback de otimização enviado pelos membros do PCI-SIG após o lançamento do projeto 0.3 em setembro de 2025.A organização afirma que o PCIe 8A especificação.0 foi concebida para proporcionar uma largura de banda elevada e uma baixa latência para indústrias com grande volume de dados, incluindo a inteligência artificial, os centros de dados, as redes de alta velocidade,computação de borda e computação quântica.
Os principais objetivos de desenvolvimento da norma PCIe de oitava geração são definidos do seguinte modo:
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Alcançar uma taxa de bits bruta de 256,0 GT/s, com um débito bidirecional de até 1,0 TB/s sob a configuração do canal x16
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Realizar investigação e avaliação sobre tecnologias inovadoras de conectores
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Cumprir padrões pré-estabelecidos de latência, correção de erros para a frente (FEC) e confiabilidade operacional
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Manter a compatibilidade com todas as gerações anteriores de PCIe
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Otimizar a largura de banda de transmissão através da iteração e melhoria do protocolo
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Adotar meios técnicos diversificados para reduzir o consumo de energia
Os dispositivos para o mercado de massa que suportam o PCIe 8.0 deverão ser lançados a partir de 2030.A próxima geração deverá dobrar a velocidade de transferência de uma única faixa para 512 GT/s, com o seu projeto de especificação a ser lançado em 2031, e a tecnologia de transmissão óptica deverá desempenhar um papel vital na nova iteração.
Com mais de 1.000 membros institucionais, o PCI-SIG reflete a ampla aplicação do padrão de interconexão PCIe.5 projeto através do espaço de trabalho membro CausewayOutras empresas e instituições qualificadas podem seguir o link oficial para completar o registo de adesão ao PCI-SIG.
Beijing Qianxing Jietong Technology Co., Ltd.
Sandy Yang, Diretora Global de Estratégia
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